Text preview for : j630tcf.pdf part of some brands - algumas marcas some schematic motherboards notebooks downloaded from www.freeservicemanuals.net. alguns esquemas placa-mae e notebook baixados de www.freeservicemanuals.net.
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J630TCF
0
support Tualatin
ULTRA ATA 100
68 6 '5
0
0
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6 8
0
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0 '11 1
0 0 8 A
3 6 6 6 3 6
3
13 4 6
6 6 16 / 6 3 1 6 3 / '15 5 4 5 1'45
5
5
'15 '
5 '1/5
1/
5 75 4/ 4
4 4' 4'5 6 :/ 5 5
5
5
'15 '
5 '1/5
1/ : 8 / ' : 06 0 6 88 / 3 6 8 6 8 48 4 4 3 6 9 6 9 / /8 8 : 8 : 8 : 8 8 : 3 6 9 8 8 8 4 4 6 / / /8 6 8 '6 8 0 0 6 28 6 A 6
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3 6 8
6 4 48 6 9 3 3 / /8 1 1 8 : 8 8 : 8 : : 8 8 6 9 3 8 :
6 4 48 / 16 8 76 8 6 0 08 2 2 3 6 A A8
0
06
6 3
'4
'5
'0 '0 '0 '0 '0 '0 '0 '0 '0 '0 '0 '0 '0 '0 '0 '0 '0 '0 '0 '0 '0 '0 '0 '0 '0 '0 '0 '0 '0 '0 '0 '0 '0 '0 '0 '0 '0 '0 '0 '0 '0 '0 '0 '0 '0 '0 '0 '0 '0 '0 '0
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0>60 0>60 0>' 5;< 5;< 5;< 5;< '15 5 5 1'45
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5 1
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1 19 4:
4 4 4
5 1/ 1/5 5 5 '5
5 75 '5;< '5;< '5;< '5 4
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5 5 '5 5 75;8< 75;< 75;< 75;< 75;< 5;< 5;< 5;9< 5;:< 5;3< 5;< 5;6< 5;8< 5;< 5;< 5;< 5;< 5;9< 5;:< 5;3< 5;< 5;6< 5;8< 5;< 5;< 5;< 5;< 5;9< 5;:< 5;3< 5;< 5;6< 5;8< 5;<
31/ 3 31/ 41/5 / 41/5 5 9 5 45 6 45 '5 28 '5
5 6: 3
5 75 / 9 75 '5 /: '5 '5 4 '5 '5 4 '5 '5 4
5 4
5 5 '5 5 '5 4
5 4
5 5 '5 5 4758 475 475 475 475 45 45 459 45: 453 45 456 458 45 45 45 45 459 45: 453 45 456 458 45 45 45 45 459 45: 453 45 456 458 45 1 16 3 13 48 13 19 4: 4 /: 8 A8 / 8
A 3 16 /8 13 6 / 4 19 4 16 9 4: 4 /:
PPGA 370
VID3 1 1 1 1 1 1 1 1 0 0 0 0 0 0 0 0
VID2 1 1 1 1 0 0 0 0 1 1 1 1 0 0 0 0
VID1 1 1 0 0 1 1 0 0 1 1 0 0 1 1 0 0
VID0 1 0 1 0 1 0 1 0 1 0 1 0 1 0 1 0
VCC_CORE 1.30 1.35 1.40 1.45 1.50 1.55 1.60 1.65 1.70 1.75 1.80 1.85 1.90 1.95 2.00 2.05
;<
;<
5 75 /
' '5
5
0>'
0
;< 0
;< 0
;< 0
;< 03 0 06 08 0 0 0 0
1 11 11
3 13 16 / / 0 /8 :
0
0
0
0
0
0
0
0
/
6 36>? 6 6>? 8 0
0 0 78 3
11 11 +
1 68 /
1 4@'@ 8 @'@
0 0 86 /
6 3 6 3 9 3 9 6 3 6 3 8 6 : 9 9 3 6 6 /
:
1 4 8 8 48 1 7 8 7 ' ' 8
>
0> 0> 0> 0> 0> 0> 0> 0> 0> 0> 0> 0> 0> 0> 0> 0> 0> 0> 0> 0> 0> 0> 0> 0> 0> 0> 0> 0> 0> 0> 0> 0> 0> 0> 0> 0> 0> 0> 0> 0> 0> 0> 0> 0> 0> 0> 0> 0> 0> 0> 0> 0> 0> 0> 0> 0> 0> 0> 0> 0> 0> 0> 0> 0> 0> 0> 0> 0> 0> 0> 0> 0> 0> 0> 0>
66 6 3/ / 7 98 63 3/ 06 : 1 1
4 48 9 6 3 8 / /8 / 1 1 1 6 9 9
6
3 1 6 3 7 76 73 ' '3 6 3 08 2 3 '6 2
7 3
MENDOCINO PPGA
15 0
6
15 0
6 0
69 / 0
6 /
|LINK |2.SCH |3.SCH |4.SCH |5.SCH |6.SCH |7.SCH |8.SCH |9.SCH |10.SCH |11.SCH |12.SCH |13.SCH |14.SCH |15.SCH |16.SCH |17.SCH |18.SCH |19.SCH |20.SCH |21.SCH |22.SCH |23.SCH |24.SCH |25.SCH |26.SCH
5 5 5 5 569 56: 563 56 566 568 56 56 56 56 589 58: 583 58 586 588 58 58 58 58 59 5: 53 5 56 58 5 5 5 5 59 5: 53 5 56 58 5 5 5 5 59 5: 53 5 56 58 5 5 5 5 59 5: 53 5 56 58 5 5 5 5
06 6@?
0
69 36? 1.2V 4
/ 8 ' / 0 : '1=5
45 45 45 45 458 456 45 453 45: 459 45 45 45 45 458 456 45 453 45: 459 45 45 45 45 458 456 45 453 45: 459 45 45 45 45 458 456 45 453 45: 459 458 458 458 458 4588 4586 458 4583 458: 4589 456 456 456 456 4568 4566 456 4563 456: 4569 45 45 45 45
1160 8 88
45;< 45;< 475;8<
45;< 45;< 475;8<
For Cu-256 PU_cmos=150 Ohm
0>' 5 5 1'45
5
5
'15 '
5 '1/5 3 : 8 9 83 6 83 83 83 83 83 83
75 4/ 4
4 4' 4'5 9 9 : 6 8 6 6 / 6 / : 0>'
0>'
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83
19
9 ) 6 : : :8 :: 3 :9
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6: 6?
For Future Compatibility Upgrate 1 '11 8 ? ?
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8
3
%!&# '%(# !#,
@ FOR FSB=133MHZ Lmax=4.5 inches
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#+
Vtt>50mil
0 0 0 0 0 75 '5 5 '5 96 5 '5 75 '5 5 '5 5 '5 6 3 6 3
0 8 8 : 8 : 3 6@:8' 6 3 6 3 6@:8' 6@:8' 6 3 6 3 6@:8'
0
6@:8'
98
9
6@:8'
0 0 0 '5 41/5 475 5 '5 45 4
5 4
5 6 3 6 3 9 8 : 8 :
45 45 458 45 45 453 45 45
8 : 8 :
0
0
0
0
0
0
8
:
8
8
8
'5 41/5 36 5 '5 45 4
5 4
5 0
6@:8' 6@:8'
8:
458 45 45 45 45 459 456 45
6
8 : 8 :
0
0
0
0
0
0
3
38
6
68
6
6
0
0
0
0
9
3
5
5
475 453 458 5 475 475
5 4758
6 3 6 3
: :
8 8 : 8 :
0 6@:8' 45 459 45 456 458 458 45 45: 8 : 8 : 6@:8' 6 3 6 3 6@:8' 6@:8' 6 3 6 3 6@:8' 6@:8' 6 3 6 3 6@:8' 6@:8' 6 3 6 3 6@:8' 8 : 6 3 6@:8' 6:
0
0
0
0
0
6@:8'
33
39
:
:6
:3
0
0
0
0
0
8
89
3
3
45 45 45 459 45 45: 45 458 459 456 45 45 45: 456 456 45 6 453 45 458 45 45 453 45 45
8 : 8 : 8 : 8 :
6 3 6 3 6 3 6 3
0
0
0
0
0
6@:8' 6@:8' 459 453 45 45: 458 453 4588 4586
3
3
0
0
0
0
8 6@:8'
8 : 8 :
6
6
:
:
6@:8' 8 : 8 : 6@:8' 6 3 6 3 6@:8' 6@:8' 6 3 6 3 6@:8' 6@:8' 6 3 6 3 6@:8'
0
0
4583 458 4589 456 4569 458: 456 458
6
0
0
0
0
8 : 8 :
83
88 83
3 83
3 83
'5
458 456 45 45 '5 45: 45 459
8 : 8 :
4568 45 4563 4566 45 456: 456 458
0
0
0
0
8 : 8 :
83
66 83
: 83
: 83
9 456 45 456 45
0
0
0
0
45;< 45;< 475;8<
45;< 45;< 475;8<
459 45: 45 45 453 45: 456 45
:
69 83
83
8 83
3 83
8 : 8 :
SCOKET 370 RT
0
0
0
0
9
6
3
9
6
NOTE: GTL+ TERMINATION RESISTORS ONLY FOR MENDOCINO PPGA PROCESSOR.
0
0
0
0
:
63 =
9 =
3:
%!&# '%(# !#,
1B
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0 0 0 0 8>? 1.2V 8 6? 9 8>E 1.2V 9 6?
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CLOSE TO SIS630E
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8 6 3 : 9 8 6 3 : 9 8 6 3 : 9 8 6 3 : 9 8 8 8 8 88 86 8 83 8: 89 6 6 6 6 68 66 6 63 6: 69
6 )
3 ) 0'' 9 9 9
: 08 9 3 6 6 3 8 : 6 6 : : 8 4
9 : 49 :
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3 3 4 9 3 : 9 : 9 3 9 3 9 3 6
4
4 9
9 9 : 4: 3 43 3
0''7
1 0
3: : 1/ 41/5 5 45 '5
5 75 '5 '5 '5 1/ 41/5 5 45 '5
5 75 '5 '5 '5 '5 4
5 4
5 5 '5 5 4758 475 475 475 475 45 45 459 45: 453 45 456 458 45 45 45 45 459 45: 453 45 456 458 45 45 45 45 459 45: 453 45 456 458 45
0
1 0''
8 8
0
1 0''7
69 6: 63 6 66 68 6 6 6 6 89 8: 83 8 86 88 8 8 8 8 9 : 3 6 8 9 : 3 6 8 9 : 3 6 8 9 : 3 6 8
: 3 8 8 03 0 3 0: 06 : 09 : : 6 9 9 3 /6 : 3 /3 / 9 1 6 /9 6 8 /: 13 19 6 1: 6 : 9 3 8 3 3 : : 6
1/ 41/5 5 45 '5
5 75 '5;< '5;< '5;< '5 4
5 4
5 5 '5 5 475;8< 475;< 475;< 475;< 475;< 45;< 45;< 45;9< 45;:< 45;3< 45;< 45;6< 45;8< 45;< 45;< 45;< 45;< 45;9< 45;:< 45;3< 45;< 45;6< 45;8< 45;< 45;< 45;< 45;< 45;9< 45;:< 45;3< 45;< 45;6< 45;8< 45;< 9 0
'5;6< '5;8< '5;< '5;< '5;< '5;< '5;6< '5;8< '5;< '5;< '5;< '5;< ;8< ;< ;< ;< ;< ;9< ;:< ;3< ;< ;6< ;8< ;< ;< ;< ;< 7;3< 7;< 7;6< 7;8< 7;< 7;< 7;< 7;<
8 48
8 8 3 : 6 9 6
9
:
3 4: 43 3
4 6
6 46 6 8 9 3 4 8 :
' ' ' '
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6 3
8
8 :
'5 '5 '5 '5
28 ' ' ' ' 8 9 : 3 6 8 73 7 76 78 7 7 7 7 7 73 7 7 7 76 7 78 8 28 6 3 96 9 98 83 28 6 3 86 28 6 3 8: 28 6 3 6 3 6 3 9 28 8 : 8 : 8 : 8 : 8 : 8 : '5 '5 '5 '5 8 9 : 3 6 8 7 73 7 7 7 76 7 78
MEMORY
4
5 4
5 5 '5 5
630-1
HOST
45 45 45 45 4569 456: 4563 456 4566 4568 456 456 456 456 4589 458: 4583 458 4586 4588 458 458 458 458 459 45: 453 45 456 458 45 45 45 45 459 45: 453 45 456 458 45 45 45 45 459 45: 453 45 456 458 45 45 45 45 459 45: 453 45 456 458 45 45 45 45 9 8 8 8 6 6 8 6 6 6 3 : 3 3 9 : 3 : 9 : 48 3 9 3 6 9
6 :
6
: 46
3
9 4 /8 16 43 49 4:
89 28 6 : 6 9 5 ''5 ''5 5 ''5 ''5 '1/ 3 3 3 :
5 ''5 ''5 '1/
'1/
/
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0
: '0 8: 6= @ '0 45 45 45 45 458 456 45 453 45: 459 45 45 45 45 458 456 45 453 45: 459 45 45 45 45 458 456 45 453 45: 459 45 45 45 45 458 456 45 453 45: 459 458 458 458 458 4588 4586 458 4583 458: 4589 456 456 456 456 4568 4566 456 4563 456: 4569 45 45 45 45 ) 6 ) 6 ) + 0 +
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45;< 45;< 475;8< %!&# '%(# !#,
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0 9 : 3 6 8 9 : 3 6 8 9 : 3 6 8 8 )
0:0
(FOR INTERNAL PLL)
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)
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6 6
8 8 8
75 75 75
75 75 75
: 3 :
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4
7;<
7 1
5;<
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9 : 9 9 49
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4
7
7 1
5
5
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4 6
7 6
7 6 1
6
5 6
5 6
/5 6
8
5 86
5
5 86 =5;<
=5;<
5
5
5
3 3
5;<
5;<
5;<
PCI
=5 =5 =5 =5 86
5 8
5 86
5 8
5 86 5 8
5 86 5 86 '5 8 '5 86 8 0'15 8 1/5 : 86 1/
'5
'5
5
5
5
5 5
5 5 '5 '5 0'15 1/5 1/ 6
6 8 /6 6 8 8 16 8
=5;< =5;< =5;< =5;<
5
5
5
5 5
5 5 '5 '5 0'15 1/5
4
8 4
6
3
:
9 8
8
6
8 4
6
1/
'5
630-2
IDE
43
3
8
6 6
6
3 3
:
6
9 3
:
9
8 3
6
4
7;<
7 1
5;<
5;<
/5;<
';<
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'5;<
'5;<
6 6 4 8 48
8
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'5
4
7
7 1
5
5
/5
4 6
7 6
7 6 1
6
5 6
5 6
/5 6
0 8 6 3 : 9 9 9 9 9 9 09 0 8 6 3 : 48 46 4 : : : : 8 6 9 / 1 9 9 9 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0
0
0
0
0
0
0
0
0
0
0
0
0 @ 20'' 20'' '60'' 0'' 0'' 0'' 0'' 0'' 0'' 0'' 0'' 0'' 0'' 0'' 0'' 0'' 0'' 0'' 0'' 0'' 0'' 0'' 0'' 0'' 0'' 0'' 0'' 0'' 0'' 0'' 0'' 0'' 0'' 0'' 0'' 0'' 0'' 0'' 0'' 0'' 0'' 0'' 0'' 0'' 0'' 0'' 0'' 0'' 0'' 8 6 3 : 8 6 3 : 8 6 3 : 8 6 3 : 8 6 3 : 8 6 3 : 0 0 08 06 0 03 0:
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';<
6
8
9
:
3
6
8
6
8
9
:
3
6
8
'5;<
';<
'5;<
6 6
;6<
;6<
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6 6
630-3
CHIPSET BYPASS 0:0 0:0 0:0 0:0 0:0 0
CHIPSET BYPASS 0:0
CAPACITOR 0:0 0:0 0:0 0
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6 06 8 6 6 8 6 8 6 8 6 6 8 8 0 8
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RTC M13
0 0'' 20
USB M12
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02 '0 '0 20
LPC PULL-HIGH PLACE NEAR TO SPUER I/O 0 8 G 6 3 45 6 3
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0>1 8 6 3 : 9 8 3 8 : 6 9 3 : 9
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addr = 1010000b
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83 8 6 3 : 9 8 8 6 3 9 6 66 6 63 6: 6 3 8 9 3 3 3 38 36 3 33 86 : :3 :: :9 9 9 9 98 6 96 93 9: 99 8 8 9 8 8 8 88 89 6 6 9 6 68 66 6 6: 69
8 6 3 : 9 8 6 3 : 9 8 6 3 : 9 8 6 3 : 9 8 8 8 8 88 86 8 83 8: 89 6 6 6 6 68 66 6 63 6: 69
8 6 3 : 9 8
3 8 : 6 9 3 : 9
0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0
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83 8 6 3 : 9 8 8 6 3 9 6 66 6 63 6: 6 3 8 9 3 3 3 38 36 3 33 86 : :3 :: :9 9 9 9 98 6 96 93 9: 99 8 8 9 8 8 8 88 89 6 6 9 6 68 66 6 6: 69
8 6 3 : 9 8 6 3 : 9 8 6 3 : 9 8 6 3 : 9 8 8 8 8 88 86 8 83 8: 89 6 6 6 6 68 66 6 63 6: 69
0'' 0'' 0'' 0'' 0'' 0'' 0'' 0'' 0'' 0'' 0'' 0'' 0'' 0'' 0'' 0'' 0'' 0''
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CLOCK SPACE > 14 mil
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1 8 6 86 9 : 6 9 3 8 1/
0 0' 0' 0' 0' 0' 0' 0
CPU CLK 2.5V LEVEL
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G
1/ 66
8
6
(5 OPTIONS) 1.ICS9248-102 (ICS) 2.ICW207 (IC Works) 3.PLL52C72-31 (Phase Link) 4.W83194R-630 (Winbond) 5.RTM540-630 (Realtek) G 0
@:8 76 3
8:4( Frequency Selection Table (FS3) 0 0 0 0 0 0 0 0 1 1 1 1 1 1 1 1 (FS2) 0 0 0 0 1 1 1 1 0 0 0 0 1 1 1 1 (FS1) 0 0 1 1 0 0 1 1 0 0 1 1 0 0 1 1 (FS0) 0 1 0 1 0 1 0 1 0 1 0 1 0 1 0 1 CPU (MHz) 66.7 100 150 133 66 100 100 133 66.7 83.3 90 95 95 112 166 166 SDRAM (MHz) 100 100 100 100 133 133 150 133 66.7 83.3 90 95 126 112 111 166 REF PCI (MHz) (MHz) 14.318 33.33 33.33 14.318 14.318 33.33 14.318 33.33 33.33 14.318 14.318 33.33 33.33 14.318 14.318 33.33 14.318 33.33 33.33 14.318 14.318 33.33 14.318 33.33 14.318 33.33 14.318 33.33 33.33 14.318 14.318 33.33 NOTE: PCICLK<37.5MHz 3 G
1
1
JP2 CPU/SDRAM AUTO 66/66 66/100 100/100 100/133 133/100 133/133 1-2 3-4 5-6 7-8 OFF OFF OFF ON ON ON ON OFF OFF OFF OFF OFF ON ON OFF OFF OFF OFF ON OFF ON OFF ON OFF OFF OFF OFF OFF JP10 ON OFF OFF OFF OFF OFF OFF JP11 ON OFF OFF OFF OFF OFF OFF 0
7 63 0
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C B E
0
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+
3 88: 9 / / + )@:6 )
88:
4 1-2 : CLEAR CMOS
88: 0603 8 @
D G
8 83 8 / '
9 88:
S
7: '6@' PLACE NEAR TO SiS 630E
NOTE: Pin D and S can NOT be SWAPPED
8 /
1%!-%)* 0=
NOTE: SIS IS NOT RESPONSIBLE FOR ANY ERRORS OR OMISSIONS IN THESE SCHEMATICS. THIS IS AN EXAMPLE ONLY. %!&# '%(# !#,
)*#!)*"#$ !"#$ '-##! 9 .
#+
ALC100/ALC200/AD1881/WM9703/CS4297A/STAC9721
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6 6
3.3V AC97 CODEC
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4 > 1
>> 1
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8
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@
) : ) 6 8 8634( 3 864A 33 6G 98 G : @) : @83 AD1881 WM9703 10U CS4297A .01U STAC9721 .1U/10U AD1881/WM9703=STUFF CS4297A/STAC9721=DO NOT STUFF 9 '/ 9 3/ 96 899/ > @
R275 X R277 X BC182 X BC183 X C200 X BC181 X BC180 X BC179 1u BC174 102P BC173 102P PIN 39 X PIN 40 X
R275 x R277 x BC182 x BC183 x C200 105P 6 BC181 x BC180 1u BC179 1u BC174 102P BC173 102P PIN 39 x Pin 40 x 38 3 3G 3G : 39 : @ ) )
3 8 8
3
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08@ 08B
08@ 08B
83G PLACE THESE COMPONENT NEAR SiS630
AMR
0 0 B0 @0 TO SUBAUDIO SYSTEM 4>
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3 : 9 ) '=/='
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3 6G
: 6G
VGA CONNECTOR 1
6 68' 0 8 68' 0 68' 0
3 1 2
CONNECTOR TOP VIEW 19ohm@100MHz 0
8 6 0
0
/
/
6 6 6
1 18 1
3 : 9 8 6 3 3G 38 3G 36 3G
4' 0' 1/ 3 :G : :G
4' 0' 6 6
6
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6
36
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: 3G
3 3G
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CONNECTOR TOP VIEW P/N:UB1112C-L1 (FONCONN) '0 L9 89 6 L10 L11 L12
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MD62: PCI Clock PLL Enable 8 =83/ 6 MD61: SDRAM Clock DLL Enable MD60: CPU Clock DLL Enable MD[59..58]: SDRAM Clock DLL'S DRC[1..0] (Default 00) MD[57..56]: CPU Clock DLL'S DRC[1..0] (Default 00) MD[55..54]: PCI Clock DLL'S DRC[1..0] (Default 00) MD32: 0=NTSC / 1=PAL MD38: Enable INTERRUPT : =83/ 69 6: 63 6 66 68 6 3 3 3 3 3 38 =83/ =83/ =83/ =83/ =83/ =83/ =83/ =83/
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5
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SPKR
RESET TURBO LED
1 3 5 7 9 11 13 15
2 4 6 8 10 12 14 16
POWER LED
TURBO S/W
IDELED
1 3
2 4
SMI S/W
ACPILED
1 3
2 4
PWR BTN
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0
0
0
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VOUT=VREF*(1+RO/RG)
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99 3
0:0
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HIP6021
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2.2K
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R57 316 8 R112 270 383 R111 1k
330
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NC
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0
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3 2 1 %!&# 11 '%(# !#,
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PWR OK:POWER GOOD FROM ATX POWER
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C/D
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LM431 f ref + -
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@
42@'4 1-3 SHORT 2-4 SHORT 0>1 0>1 0>1
PS_ON# FROM SIS630 630CKE FROM SIS630 PIN F6
PIN D1 60>
9
9
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3 8
: 0>1 38103
6 3 3 VCC and VCC3 Standby VOLTAGE SWITCH WHEN IN S0,S1 THIS CIRCUIT PASSES THE NORMAL POWER WHEN IN S3,S4,S5 THIS CIRCUIT PASSES THE STANDBY POWER 3 6 8 : 38103 : 8 /;< 8 : 8 38103 8 3 6 / / / / 8 : 88 3I8
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83 0 6 83/ 2 0
0 930 0
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2 6
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5 '5 '5 '5 '5 0 5
5 8 69 6: 63 6 66 68 6 6 6 6 89 8: 83 8 86 88 8 8 8 8 9
2 8
5 8 5 8 ' 8 '
8 5 8 '5 8 '5 8 '5 8
5 8 5 8 ' 8 '
8 5 8 '5 8 '5 8 '5 8 '5 8 5 8
5 8
Temperature Sensing
& COMB
Voltage SENSING
:934
Fan Speed Seneing & Speed Control
COMA
0
GAME PORT
6
0
25 5 '5 0 '5 5
5 '5 5 5 /5 5 5 45 '/4
5 1/
1/ 175 '
7 0 1 1 1 1 15 1'5 '1 ' /5 5 '1
5 3 6 8
8 6 3
Printer
;3< ;3< 8
8 6 3 : 9 8 6 3 : 9 8 6 3 : 9 8 6 3 :
0 9
0 '
8: : 931/ 175 '
7 1;< :
'1
5 8 5 8 /5 8 ' 8 8 '1 8
0 8: /
432@'
FDC
: 8
9
3 6
'/ 7 98
9
28
1;<
1 1 1 1
%!&# '%(# !#,
15 886
'5
:934C1
=B4=B1'4
=D
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#+
COM PORT
0 '5 5 '
5 '5 '5 '
5 6 9 : 3 8 0 8 6
36 (SOP20) B0 8 9 @0 6 : 8 3 9 ' '
' ' '
B0
IR/CIR CONNECTOR
'
'
28 8 28 8 28 28
'
'
6 3 9 8 : 6 3 9 9 8 : '
' '
0' 0
8 6 3 : 9
2
0 '5 5 '
5 '5 '5 '
5
6 9 : 3 8
9 0 8 6
36 (SOP20) B0 8 9 @0
6 : 8 3 9 ' '
' ' '
' ' ' '
' ' '
' ' '
6 3 8 : 6 3 6 3
8 : 6 3 8 : 8 :
2
2
COMA
(UARTA)
462@'
'
' ' THE IOVSB OF PIN 8 IS FOR CIR WAKE-UP FUNCTION.
426@'
COMB
@0
(UARTB)
0
88: 3 6 3 6
PRT PORT
8 3/28
3/28
8 3/28
3 6 : 8 8 3/28
39 3/
: 8 : 8
'5 5
5 '1
5 ;3< ;3<
6 3
8 :
: 8 3 6
28 6 3 3 8 :
28 8 6 3 6 3 : 8 :
28 5 /5 ' '1 66 : 8 : 6 3 6 3 6 3 8 :
8 6 8 3 6 : 9 3 : 9 8 6
6@
6 :@:8 8 : :@:8 8 : 3 :@:8 6 3 : :@:8
%!&# '%(# !#,
:934C1
=B4=B1'4
=D
)*#!)*"#$ !"#$ '-##! 8 .
#+
GAME & MIDI PORT CIRCUIT
0
0
3 6
6 /28 6 / 63 /
0 16
3
/
: 8
'
'
'
'
1 13 8 : 19 1 6
/
2
2
'
'
6 3
/28
: 6 3 8 6 8 9
8 :
6 3
: 8
8
6 28
6@
9 28 6 3 6 :
FLASH ROM
0 SELECT 2M-FLASH ROM, UNINSTALL R258 SELECT 4M-FLASH ROM, INSTALL R258 38 : 23 2 26 28 2 2 2 2 29 2: 23 2 26 28 2 2 2 2 9 : 8 6 3 6 3 : 9 8 =: 3 6 8 9 : 3 6 8 5 5 5 9=8 7 7 7 7 78 76 7 73 8 6 3 : 9 2 2 2 2 28 26 2 23
IOVSB CIRCUIT
RX1 @ 6 0 2;3< @6:3 2;3< '60 @6:3 83/28 6 @ OnNow or Wake_up function power RX1 OFF, D1,D2 ON: Wake_up fuction RX1 ON, D1,D2 OFF:NO Wake_up fuction
0'
6:
2:
0 2 2 2 2 28 26 2 23 8 : 8 : 33 6 3 6 3
REFERENCE TO PAGE 21
2;:<
2;:< 0
83/
83/
69 83/
0
0 68
3: 83/28
5 5 '5
%!&# '%(# !#,
:934C1
=B4=B1'4
=D
)*#!)*"#$ !"#$ '-##! 6 .
#+
Hardware Monitor circuits
Temperature Sensing Voltage Sensing
0 : / 0
930 930 63/? 9 /? @0
@0
930
/?
/
(for system)
0
/
B0
0
B0 8 / B 2 2 : 3 :/>? />?
B0
(from CPU)
+!%
PWM Circuit for FAN speed control
B0
: 6 G
8
83/ / B E 78 9 C 88:
8 83/ 8 GND 12V SEN 3/ 9 /
D 76 3 S
)
+ 42@
23
C/D
3 83/ / B E 7 9 C D : 6 G S 73 3 + )
1 B0
2
3
B/G
E/S
: 88:
83/ 6 3/ / 18 0 19 0
'' 42@
23
'60 : 88:
3 88: : 6/
: / 63 G BY EXPERIENCED
9 88: 96 ) 6 ) 3: ) 68 ) 83 ) + + 6 ) 1 42@1 1 X 2 3 GND RING 0 SB5V
8
8
+ 3
%!&# '%(# !#,
:934C1
=B4=B1'4
=D
)*#!)*"#$ !"#$ '-##! .
#+